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[原创] 请教转cdl问题

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发表于 2011-12-22 15:52:17 | 显示全部楼层 |阅读模式

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线路上有个很小很小的电阻,版图上不需要画出来。我现在转cdl时候,能不能把这个电阻屏蔽掉。或者只能去改网表吗
发表于 2014-10-31 14:25:38 | 显示全部楼层
cdl导出时的设置没有用,最后还是修改command file解决。好奇地问一下,这样的话,那个cdl out时的resistor threshold value设了有什么用呢?
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发表于 2013-9-5 10:22:21 | 显示全部楼层
resistor threshold value 里面可以设置过滤值
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发表于 2012-3-31 17:52:03 | 显示全部楼层
貌似在导cdl出来的时候可以设置小于多少的电阻不被提取
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发表于 2012-3-30 15:23:49 | 显示全部楼层
学习啦
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发表于 2012-3-30 11:50:08 | 显示全部楼层
学习下
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发表于 2012-3-22 18:05:25 | 显示全部楼层
学习了
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发表于 2012-2-10 17:35:10 | 显示全部楼层
怎样在电阻上加lvsIgnore 的属性,高人能说详细一点吗?
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发表于 2012-2-8 16:32:55 | 显示全部楼层
又学习了好多
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发表于 2012-2-7 17:28:11 | 显示全部楼层
学习下!
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发表于 2012-2-3 20:23:12 | 显示全部楼层
cdl out有最小电阻值的设定
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