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查看: 376|回复: 6

[原创] USB IP Verilog 讲解视频课程已全部录完

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发表于 2024-6-14 17:59:56 | 显示全部楼层 |阅读模式

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USB IP verilog 讲解视频课程已全部录完,总共大概12个小时的课程,逐行讲解了USB IP全部的RTL Code(full speed), 在code 讲解过程中结合Modelsim 仿真波形,穿插讲解了涉及到的USB 协议,比如总线复位, DATA0/DATA1 Toggle 机制,EndPoint ,Verilog 的组合逻辑、时序逻辑及状态机的描述等内容。
下面是课程的基本框架:
1.USB IP的框架及数据流;
2. Testbench 的code 讲解;
3. device_core的code讲解;
4. sie_tx 的code讲解;
5. sie_ep 的code讲解;
6. fifo 的code讲解;
7. rf 的code讲解;
8. crc16 的code讲解;
sie_rx 在免费的课程中讲过了,device_core中sie_rx 剩余code的讲解。
淘宝搜 malogic 可找到店铺购买。
2C87457ECB717F70A9C4D9D6243C53E3.png 以上为讲解的对应verilog file

0CE1A08CCE8B38B0A79598FE14F4C9F9.png 42585FD60457623EE4D90A4975272DE5.png 96F3CF52DD23A40961B75816568D0716.png 7F81635BEEBA3491BB2812CC5D128C56.png EF72BC184FC841E2F0EB9128547C28E8.png F1FCCFA684D5B392D737FF23072A5F4E.png



发表于 2024-6-14 20:13:33 | 显示全部楼层
谢谢
发表于 2024-6-15 00:46:37 来自手机 | 显示全部楼层
666666666
发表于 2024-6-15 13:18:15 | 显示全部楼层
kan xie
发表于 2024-6-16 09:01:52 来自手机 | 显示全部楼层
Thanks for sharing.
发表于 昨天 12:04 | 显示全部楼层
感谢
发表于 昨天 17:13 | 显示全部楼层
感谢
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