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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog Layout（版图） › Layout讨论区 › DRC的问题后续
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楼主: lanfumei

[求助] DRC的问题后续

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WXEK狂
发表于 2024-4-23 11:43:24 | 显示全部楼层
大概率输出的gds路径中的某一个层级没有权限
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C7cgff
发表于 2024-4-23 14:15:57 | 显示全部楼层
截run DRC 报错时的CIW，一般是哪个底层没权限，是个白色的X，或者说有自制的pcell，在calibre setup layout export里勾选 export from virtual memory
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