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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog Layout（版图） › Layout讨论区 › DRC错误求助
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查看: 526|回复: 3

[求助] DRC错误求助

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hwt953471811
发表于 2024-2-8 13:49:43 | 显示全部楼层 |阅读模式

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这个应该怎么改呀？改了V2，金属层大小也跟着改变，然后金属层就太小了

                               
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liyifeng
发表于 2024-2-18 08:57:37 | 显示全部楼层
VIA的大小都是固定的 只能按照固定的大小去画
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wesley_wan
发表于 2024-2-18 09:20:19 | 显示全部楼层
正常按照RULE画的layout不会有这么多VIA SIZE的错误
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wesley_wan
发表于 2024-2-18 09:23:19 | 显示全部楼层
反正这个ERROR最好是全部清掉
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