PLL参考杂散/测spur

hglsy · 发表于 2023-4-20 09:34:49

kuxuanxinzai 发表于 2023-4-14 12:43
关于让信号频率落在FFT整数bin点的情况，我理论上知道确实应该这样，但是在cadence中应该如何设置呢？之 ...

谢谢您，我得好好看看信号与系统了，诚如您所说，我确实对这些变换以及窗函数、谱分析的理解不够，即使能正确使用仿真器，但是其实没有实际的直观理解。非常感谢您。

RFIC从零开始 · 发表于 2024-1-10 09:15:42

Mark，FFT相关见解

张江板砖工头 · 发表于 2024-1-13 23:53:53

mmmmmm

自由的风LLLDDD · 发表于 2024-5-19 13:06:31

学习了

K1rost · 发表于 2025-4-3 13:18:22

学习了！

骑着小猪看夕阳 · 发表于 2025-7-9 10:06:55

请问您，最后这个问题解决了吗，我也遇到了类似的问题

its_aleix · 发表于 2025-9-24 16:47:17

kuxuanxinzai 发表于 2023-4-14 12:43
关于让信号频率落在FFT整数bin点的情况，我理论上知道确实应该这样，但是在cadence中应该如何设置呢？之 ...

谢谢前辈的解答，学习了

hcbenson · 发表于 2025-9-24 23:57:48

先記錄下來，當作收藏。

户下之羽 · 发表于昨天 16:20

不好意思麻烦问一下，我自己的模块后仿发现带ESD的PAD驱动能力不够，无法拖动模块内96M信号正常输出(当时考虑数字PAD可能会有整波效果，出来的波形可能是特别正的方波，影响测量jitter，因此使用了foundry提供的模拟PAD，后续后仿发现更糟糕，模拟PAD所需驱动能力过大，无法正常输出高频时钟波形)，但目前已经投片，只能寄希望于小数分频器输出信号(频率和fref接近)的这个信号进行大致反推了，该分频输出信号后仿结果带模拟PAD是正常的，请求各位大佬能否帮帮忙，看看我这种案例如何根据小数分频器输出信号反推小数锁相环输出信号相位噪声(如果小数杂散存在反推的方法也请各位大佬指点一下)，十分感谢！

户下之羽 · 发表于昨天 16:21

不好意思麻烦问一下，我自己的模块后仿发现带ESD的PAD驱动能力不够，无法拖动模块内96M信号正常输出(当时考虑数字PAD可能会有整波效果，出来的波形可能是特别正的方波，影响测量jitter，因此使用了foundry提供的模拟PAD，后续后仿发现更糟糕，模拟PAD所需驱动能力过大，无法正常输出高频时钟波形)，但目前已经投片，只能寄希望于小数分频器输出信号(频率和fref接近)的这个信号进行大致反推了，该分频输出信号后仿结果带模拟PAD是正常的，请求各位大佬能否帮帮忙，看看我这种案例如何根据小数分频器输出信号反推小数锁相环输出信号相位噪声(如果小数杂散存在反推的方法也请各位大佬指点一下)，十分感谢！

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