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[求助] design中新增加module相关cell抓取

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发表于 2022-5-20 15:44:27 | 显示全部楼层 |阅读模式
800资产
ic新人求助,如题,design中新加了两个module,需要在netlist中抓取新加module的相关cell用以评估面积增加,包括module本身reg cell以及带来的clock tree、buffer增加cell,求个思路?用DC可以直接完成吗。

发表于 2022-5-21 11:12:54 | 显示全部楼层
有一个report命令,可以逐层列出所有的cell,好像是report_hierarchy, report_cell 也行
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