sdc文件是怎么产生的？

helimpopo · 发表于 2021-3-6 21:43:51

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DC综合之前写一个简单的，喂给DC，然后生成一个更全面的sdc文件吗？
为什么我DC综合，吃的和吐的sdc文件都一样？？

zhai6396705 · 发表于 2021-3-6 22:52:25

马克

kk2009 · 发表于 2021-3-7 05:14:13

sdc是timing的约束文件，这个是designer对RTL设计上的约束，包括dont touch， timing等，基本上是吃进去什么，就吐出什么，工具怎么知道你要加什么约束？
唯一多的就是对clock gate cell的约束，这个是工具产生的因为clock gate cell是工具插的，但是也是基于读进去的sdc。