这一电路的输出阻抗匹配怎么优化一下？

C_Spectator · 发表于 2020-6-5 17:14:45

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如图，系统最后一级用这样的结构做Output Buffer。系统的带宽是朝着（100k~）45GHz以上做的，现在增益带宽是可以做到45GHz以上了，但回过头来发现输出阻抗匹配的不太好，-3dB带宽内<-10dB的要求达不到。
这一级能挑的参数也不多，而且调起来S22也调不到-10dB以下。
别人的论文里看到的办法，就只有一个在输出端串电感，尝试过后发现这个方法效果不大。

所以，想跟大佬们请教一下，这一结构的Output Buffer还有什么别的阻抗匹配的结构可以使用一下的么？提前感谢~

C_Spectator · 发表于 2020-6-9 12:07:10

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