设为首页收藏本站
在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名：电子顶级开发网)

手机号码，快捷登录

手机号码，快捷登录

找回密码

  登录   注册  

快捷导航
创芯云服务  : 创芯大讲堂  | 创芯人才网 | 数字IC职业培训  EETOP诚邀线上IC培训讲师!
搜帖子
EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证资料 › AES内核的SystemVerilog实现
返回列表 发新帖
查看: 2060|回复: 4

[原创] AES内核的SystemVerilog实现

[复制链接]
ajzcr
发表于 2017-3-30 22:03:42 | 显示全部楼层 |阅读模式

马上注册，结交更多好友，享用更多功能，让你轻松玩转社区。

您需要 登录 才可以下载或查看，没有账号？注册

x
https://github.com/zhouchuanrui/AESinSV

小弟实现的AES内核, 有需要的可以下来看看, 能加个星啥的就更好了.
畅销就业培训课《芯片验证从入门到精通》推荐就业，赢取高薪！
回复

举报

babikambing
发表于 2017-4-2 21:08:31 | 显示全部楼层
回复 1# ajzcr


       thanks
畅销就业培训课《芯片验证从入门到精通》推荐就业，赢取高薪！
回复 支持 反对

举报

tracybetty
发表于 2017-5-29 10:33:25 | 显示全部楼层
谢谢  学习下  不错
回复 支持 反对

举报

tracybetty
发表于 2017-6-4 12:44:56 | 显示全部楼层
不错的东西  支持下
回复 支持 反对

举报

pangpzi
发表于 2019-7-11 14:32:20 | 显示全部楼层
看看去
畅销就业培训课《芯片验证从入门到精通》推荐就业，赢取高薪！
回复 支持 反对

举报

返回列表 发新帖
高级模式
B Color Image Link Quote Code Smilies
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /2 下一条


小黑屋| 手机版| 关于我们| 联系我们| 在线咨询| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2024-11-28 14:30 , Processed in 0.019710 second(s), 7 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
快速回复 返回顶部 返回列表