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[讨论] ultraedit verilog模板脚本

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发表于 2016-1-31 09:36:39 | 显示全部楼层 |阅读模式

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使用js脚本语言,如何根据模块io名生成例话名。能给个脚本例子吗?
发表于 2016-2-1 08:47:14 | 显示全部楼层




    这个很简单,用js脚本分析即可
    你可以去 www.micrortl.com看看,这个网站有一篇帖子实现了这个功能
 楼主| 发表于 2016-2-1 17:01:22 | 显示全部楼层
回复 2# haitaox
你使用过他的脚本吗?我用起来有bug,脚本怎么设置断点调试?
发表于 2016-2-2 08:49:12 | 显示全部楼层


回复  haitaox
你使用过他的脚本吗?我用起来有bug,脚本怎么设置断点调试?
luoyanghero 发表于 2016-2-1 17:01




    我用过啊,没问题啊,js脚本好像不能设置断点的
    你可以在他的网站提问的
发表于 2016-2-2 08:51:37 | 显示全部楼层
回复 3# luoyanghero


    http://micrortl.com/?p=212
就是这篇文章,
FPGA代码编辑器UltraEdit高手进阶–脚本功能之模块例化(7)

用起来没有问题,不过,你要先在 f:\test目录建立一个 UE_TMP.v的文件
 楼主| 发表于 2016-2-5 11:54:32 | 显示全部楼层
回复 5# haitaox
没弄明白怎么生成inst。我这样操作了,没有成功:我在自己的.v文件里面运行modulemap.js脚本。没有看到在f:\test\UE_TMP.v看到例化。能说一下你是怎么操作的的吗?
发表于 2016-2-9 23:40:22 | 显示全部楼层
回复 1# luoyanghero


      看看看!!!!!!!!!!!!!!!!!!!!!!!!!!
发表于 2016-2-16 14:17:42 | 显示全部楼层
回复 6# luoyanghero


    你可以在网站上跟作者提问,他比较在行
发表于 2021-2-22 22:23:11 | 显示全部楼层
www.micrortl.com 这个网站现在不能访问了,请问还有什么路径可以获得这个自动例化脚本吗?
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