verilog代码转换门级表示

yyhh830 · 发表于 2013-9-3 15:02:03

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本人新人菜鸟
请问写了一些verilog代码(可综合的语句）之后，能否（怎样）把它转化成门级（最简单的门）表示的verilog代码呢？（什么工具，DC可以吗?)

goco · 发表于 2013-9-3 16:30:59

网表不就是门级的VERILOG嘛你还要什么

woodhorse · 发表于 2013-9-4 17:16:23

dc可以。还要一个综合库。

tyxuanyuanlx · 发表于 2013-9-5 09:00:52

回复 1# yyhh830

所谓的可综合，就是可以通过综合软件映射到标准单元，看来楼主对于verilog的一些概念还不是很熟悉啊，建议你看看《Verilog HDL数字设计与综合》这本书，应该能解决你的问题。

lymrlym · 发表于 2013-10-12 08:12:40

DC可以的。或者用FPGA工具。

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