DDR2 FPGA调试求助！！！！

harejavahill · 发表于 2012-10-25 10:35:44

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小弟现在用DE3的FPGA板调试DDR2的controller IP，但一直无果，请大侠指点：
DDR2 controller IP是买的IP，在EDA上仿真没有问题。但下到板中，却一直没有结果。
我在EDA上仿真时，用的时钟频率是200M，到FPGA板时，其时钟频率用的是35,
请问这个频率去仿问DDR2会不会有问题？

harejavahill · 发表于 2012-10-25 13:45:17

没有一个人回复？！

ruozhuo · 发表于 2012-10-25 15:16:50

35M吗？应该没问题的，ddr2的IO频率最高能到266~400M

keyway · 发表于 2012-10-25 15:28:01

DE3 買不起

harejavahill · 发表于 2012-10-25 15:54:22

谢谢回复，目前好像有点思路了，可能是PIN ASSIGNMENT引起的，确定中。。。
DE3，其实不用好。。。。。。。

xuy731 · 发表于 2012-10-25 16:47:21

有的DDR2是有频率下限的，一般为125M，控制器也会有频率下限,具体要看芯片手册了

harejavahill · 发表于 2012-10-25 17:24:54

谢谢大家关心，最终得到，还是PIN ASSIGNMENT导致的。。。。

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