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[求助] Verilog的初学者

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发表于 2012-10-22 13:11:29 | 显示全部楼层 |阅读模式

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我是Verilog的初学者,请问各位大虾们,怎样才能更快更好的入门Verilog呢?怎样才能学好呢?
发表于 2012-10-22 14:34:29 | 显示全部楼层
先读本语法书,然后就自己尝试写通用模块并学习别人的写法。
发表于 2012-10-22 14:58:29 | 显示全部楼层
有多迫切,有多努力,就有多块
发表于 2012-10-22 15:06:55 | 显示全部楼层
弄懂语法,然后多练习,多看优秀代码
发表于 2012-10-22 17:22:26 | 显示全部楼层
看书,同时做些小的实验
发表于 2012-10-22 22:59:19 | 显示全部楼层
楼上说得对
发表于 2012-10-24 21:39:11 | 显示全部楼层
实际中就是0/1都有可能,仿真的话一般还是给你个x
怎么不搞个defualt呢
发表于 2012-10-24 22:57:45 | 显示全部楼层
看语法书,然后按照例子练几个
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