时序约束

liuyangqwin2 · 发表于 2012-7-4 21:28:03

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各位前辈，问个问题：
有一个模块输入有一个主时钟clkin 输出有一个时钟端口clkout（其他模块的时钟信号）这个端口输出的时钟频率为15hz 或7.5hz或3.75hz（用控制端口控制）
怎么约束着个时钟啊是否按15hz 约束就行了

陈涛 · 发表于 2012-7-4 22:31:56

15Hz
这么慢！用约束吗？

陈涛 · 发表于 2012-7-4 22:34:39

15Hz

这么慢！用约束吗？

liuyangqwin2 · 发表于 2012-7-5 10:28:23

回复 3# 陈涛

确定是15hz，是不是就按15hz约束就行了？
如果分别是15M 7.5M 3.75M 是不是按15M约束就行了？

陈涛 · 发表于 2012-7-5 15:46:18

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