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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog Layout（版图） › Layout讨论区 › 请教：升压降压电路版图 latchup 防护
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楼主: calear

[讨论] 请教：升压降压电路版图 latchup 防护

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frontier
发表于 2012-2-14 13:39:46 | 显示全部楼层
1. 刚上电大概30微秒vh<vcc
   上電前, vh到底是多少?
   vl 的電合時給的
   畫個power on圖?
2. NMOS的Pwell有沒有ring?
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calear
 楼主| 发表于 2012-2-15 16:37:24 | 显示全部楼层
再顶顶
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hao_0071
发表于 2012-3-2 09:07:48 | 显示全部楼层
相互间用nmos
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verilog001
发表于 2014-3-29 09:17:59 | 显示全部楼层
还真的挺难的。
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