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楼主: benselang

磕头求助关于Verilog HDL的一段小程序

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发表于 2009-10-29 08:48:29 | 显示全部楼层
实在看不懂你的代码 spi通信的话只有SCK MISO MOSI CS 四个信号

你的ParaData RevData是干什么的 从哪儿来到哪儿去也没说明白 想帮你我也帮不上忙的
发表于 2009-10-29 10:16:16 | 显示全部楼层
为什么又是output 又是reg
那是verilog2001的新语法。
发表于 2009-10-29 10:36:48 | 显示全部楼层
output reg 标准语法格式
发表于 2009-10-29 11:06:31 | 显示全部楼层
always为一个语句时,就不需要用begin......end了!
 楼主| 发表于 2009-10-29 14:34:10 | 显示全部楼层
本帖最后由 benselang 于 2009-10-29 16:21 编辑

回复楼上的那位大叔
output MISO; reg MISO; 或者 reg temp; assign MISO=temp;这是两种常用的方法我用的output reg MISO 其实和上面的一样,从一本书上看来的。另外,不知道您年龄多大,请您不要随便做别人的长辈。或者做别人的晚辈。“大叔,我帮你看看吧”,呵呵,开个玩笑谢谢您的回答
SPI通信没错是包括MISO,MOSI,SCK,SSEL(CS),但是这只是对外的引脚,那么模块内部怎么把数据输入到SPI移位里边以及怎么把以为得到的数据得出呢?
我用了ParaData表示并行输入spi模块的数据,用RevData表示从SPI模块输出的接收到的并行数据,如此而已,如果有描述不清楚的地方还请见谅
发表于 2009-10-29 22:38:52 | 显示全部楼层
你的问题在于头脑中几乎没有HW的概念,没有想过你键盘下的code对应怎样的HW单元,完全是抽象的写verilog code,不符合HW的规范,肯定综合不出自己想要的结果。最好还是先理一下思路,能不能尽量搞一个稍微详细的硬件模块图来。然后再写code.
发表于 2009-10-29 22:51:02 | 显示全部楼层
想学习。。。。。
 楼主| 发表于 2009-10-30 07:50:49 | 显示全部楼层
16# tbb2009
您好,请问您说的HW是HardWare的缩写吗?
个人是个新手,只用过单片机和ARM,不足之处请见谅,可能思路还是按照编写单片机的方式来写的,但是有点问题,Verilog不是可以进行行为级别的建模吗?我直接描述行为应该也可以吧。
我现在实际做的就是一个模块spimod,顶层模块spi只是为了用ARMSPI读出时判别是否正常运行而给了几个值而已,如有不对,还请详细指教。
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