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[其它] pll设计

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发表于 前天 22:50 | 显示全部楼层 |阅读模式
购买主题 已有 34 人购买  本主题需向作者支付 5 信元资产 才能浏览
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发表于 昨天 01:01 | 显示全部楼层
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发表于 昨天 07:47 | 显示全部楼层
至少有个简短说明，让大家知道是什么资料吧？上来就得先付信元才能看，这样不太好。
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发表于 昨天 09:14 | 显示全部楼层
看了下，好像是用verilog写的一个小数分频的PLL，附上他给的文件，大家自己学习吧
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发表于 昨天 09:15 | 显示全部楼层
看了下，好像是用verilog写的一个小数分频的PLL，附上他给的文件，大家自己学习吧

eetop.cn_1.docx

15.14 KB, 下载次数: 2 , 下载积分: 资产 -2 信元, 下载支出 2 信元
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发表于 昨天 09:42 | 显示全部楼层
1.docx 文档只是给了 verilog 代码，却没有任何的技术讲解说明。
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