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统一鲜橙多 发表于 2024-6-4 13:57 waive
harry_hust 发表于 2024-6-4 14:48 数据信号分两路,一路正常做数据,一路插一个CK buffer,clock create 在 buffer 输出端 ...
kassadin 发表于 2024-6-6 10:59 老哥,创建时钟是用前级触发器的时钟派生嘛,具体时钟频率怎么定义呢?像边沿捕获这种逻辑,脉冲是随机产 ...
harry_hust 发表于 2024-6-6 13:55 既然是clock,肯定是要综合的时候加的。 可以create generated clock,频率可以看前级触发器输出的最高频 ...
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