需要一个随机时钟来做仿真，请问如何得到一个随机时钟啊？

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在一个时钟周期内，时钟高电平出现的位置是不一定的，随机化的，pulse width是固定的。

这样的时钟，有什么简单的办法来生成呢？

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kk2009 发表于 2024-1-22 06:14
`timescale 1ns/1ps
module top;

谢谢，这个$random是什么啊？服从什么分布的随机数啊？

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龙9527 发表于 2024-1-22 09:15
调用vprbs

谢谢，可以生成均匀分布的随机数吗？

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kk2009 发表于 2024-1-23 02:23
random是verilog的内建函数，是平均分布

谢谢，verilog内部有各种不同的分布函数吗？

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kk2009 发表于 2024-1-24 12:05
verilog 里只有这一个。

systemverilog应该还有好几种。

如果需要用到不同的随机分布函数，那只能用veriloga来自己写？