[求助] 求助: quartus增量编译与逻辑锁？

发表于 2011-10-21 09:21:43 | 显示全部楼层

遇到这种问题,我建议你先从B模块的功能角度查错,包括A和B的借口部分,因为仿真的时候很多情况可能漏掉.

不知道你芯片的资源利用率怎么样,设计是不是真的复杂到要用logic lock. 反正绝大部分设计出问题还不是timing的问题,而是function的问题.

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