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[求助] Pattern test Vmin

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发表于 2024-4-17 14:24:09 | 显示全部楼层 |阅读模式

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有大佬知道怎么降低pattern 测试过程中Vmin 高这一现象吗?是什么原因导致的呢?希望不吝赐教。
 楼主| 发表于 2024-4-17 14:48:18 | 显示全部楼层
老化前的,是SS 的片子,比预期情况高不少
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 楼主| 发表于 2024-4-17 14:54:11 | 显示全部楼层


   
quanqiutong 发表于 2024-4-17 14:43
你的Vmin是老化后统计出来的吗?是否设的太低了


老化前的,是SS 的片子,比预期情况高不少
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 楼主| 发表于 2024-4-17 15:12:40 | 显示全部楼层


   
quanqiutong 发表于 2024-4-17 15:02
生成pattern时,analog是否关闭? 没关闭也有可能出问题


analog  是黑盒处理的,pattern 不cover 这一部分
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 楼主| 发表于 2024-4-17 16:00:46 | 显示全部楼层


   
quanqiutong 发表于 2024-4-17 15:46
还是要有disable analog的控制,否则analog有可能会在Vmin时工作状态不对,这就有引起Vmin不对
...


你的意思是analog 工作时影响到scan pattern  的 Vmin,这个应该没用到analog吧
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 楼主| 发表于 2024-4-17 17:26:23 | 显示全部楼层


   
quanqiutong 发表于 2024-4-17 17:18
analog可能在抖动,所以有影响,而且电压对analog的工作状态也有影响


那这样的话,我应该怎么试是不是这样呢?再测pattern 的时候测下analog 的 电压吗
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 楼主| 发表于 2024-4-17 18:14:20 | 显示全部楼层


   
quanqiutong 发表于 2024-4-17 17:39
这种都是要多尝试的,看是哪里的问题,如果有多个电源,可以一个个测看看 ...


试了下,不是analog 影响的

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 楼主| 发表于 2024-6-13 09:47:07 | 显示全部楼层


   
锋wi 发表于 2024-6-12 16:32
只是SS Vmin偏高?读一下RO的值看工艺是否拉的太多了


都偏高,就是SS差的太多,工艺确实拉了一点
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 楼主| 发表于 2024-6-13 09:48:26 | 显示全部楼层


   
John_Zhang 发表于 2024-6-12 17:04
降频有改善吗?


降频会有改善,但是还是希望正常频率下有改善
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 楼主| 发表于 2024-6-27 14:32:44 | 显示全部楼层


   
John_Zhang 发表于 2024-6-13 09:54
那就是功耗问题么,出个低功耗pattern看看


低功耗pattern 降低很有限,倒是有点降低

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