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VHDL for MPEG4

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发表于 2004-3-24 22:51:41 | 显示全部楼层 |阅读模式

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我得到一个MPEG4 IP,愿与大家共享。由于目前尚未涉及这部分工作,所以没有验证过。
文件比较大,真有需要的,可以PM给我。
 楼主| 发表于 2004-3-25 16:59:57 | 显示全部楼层

VHDL for MPEG4

to flik:
邮件正在发出,共7封,请查收。
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发表于 2004-3-26 15:15:25 | 显示全部楼层

VHDL for MPEG4

我也要
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发表于 2004-3-27 01:53:00 | 显示全部楼层

VHDL for MPEG4

[这个贴子最后由ddsyly在 2004/03/27 02:19am 第 1 次编辑]

Could you give me one ?
Thanks!
my E-mail is:ddsyly2002@163.com
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发表于 2004-3-27 19:39:37 | 显示全部楼层

VHDL for MPEG4

急切需要,哥们支持一下吧!
我的邮箱:renfengyuan003@163.com
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发表于 2004-3-27 22:15:07 | 显示全部楼层

VHDL for MPEG4

请给我一份吧,多谢yang_tch@163.com
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 楼主| 发表于 2004-3-27 23:04:51 | 显示全部楼层

VHDL for MPEG4

楼上的各位请放心,我会发给你们的,只是我的邮箱比较小,要发7次,比较麻烦。
因为这个IP原本不是OPEN的,怕给论坛带来麻烦,所以没有直接往论坛上放。有机会的话我可以考虑上传到斑竹的FTP上,可惜我一次也没能登陆上去。(是不是只有特定的时间开放?有什么诀窍请斑竹发短消息给我。)
另外,我声明是和大家一起学习用,请不要公开传播,呵呵。
这个IP是一个MPEG-4 Video Encoder Core,但对于MPEG-4,有了Encoder也就有了Decoder。下面是介绍:
The core supports a wide range of image sizes (Advanced Simple Profile Levels 1 to 5), making it suitable for applications from video conferencing to real-time VGA video streaming. Advanced functions like DCT are built-in, and it requires only an external SDRAM for frame storage and any processor for supervision.
Developed for easy reuse with ASICs or FPGAs, the core fits in 40K ASIC gates.
Features
Fully compatible with the ISO/IEC 14496-2 specification
Supports Advanced Simple Profile Level 1 to 5
Capable of processing full resolution video (beyond 4CIF), e.g. 704 x 576 @ 30 fps
Very low operational frequency: from ~3 MHz for QCIF @ 15 fps
Min Clock speed = 8 x the raw pixel clock speed
Advanced features and functions built in:
DC prediction
Variable Bit Rate
Motion vector up to –16.0/+15.5 pixels (I-VOP and P-VOP support)
The processor includes IEEE-1180 compliant DCT/IDCT and type 1 quantizer/dequantizer
Glueless interface to SDRAM for frame storage (a single 16 Mbit or 64 Mbit SDRAM chip with 16-bit data bus is sufficient for most applications)
Supports YCbCr 4:2:0 raster video input
The core outputs I and P Video Object Planes
Fully synchronous design
Available in VHDL or Verilog synthesizable RTL, or optimized for FPGAs.
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发表于 2004-3-28 10:33:57 | 显示全部楼层

VHDL for MPEG4

发我一份好吗?我的邮箱是lixf1715@vip.sina.com,先谢了!
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头像被屏蔽
发表于 2004-3-28 12:14:39 | 显示全部楼层
提示: 作者被禁止或删除 内容自动屏蔽
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发表于 2004-3-28 22:47:19 | 显示全部楼层

VHDL for MPEG4

请给我也发一份吧,多谢!
iamchine@yahoo.com
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