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[讨论] IC设计十年,这个账户12年,大家有啥想问的随便问,大牛路过就好,主要是新人们

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发表于 2017-12-15 20:19:32 | 显示全部楼层 |阅读模式

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本帖最后由 rvisk 于 2017-12-15 20:46 编辑

2005年注册的这个账户,当时从edacn转过来的,从这里学习了很多东西,挺感谢eetop.做ic的兄弟们大部分比较忙,我最近比较闲,大家有啥想问的,随便问,尽力回答,对答案正确性不保证,不要喷我!  对了,我做数字的。。。。
 楼主| 发表于 2018-1-19 14:39:02 | 显示全部楼层
回复 36# Marvin.Liang


1. 对于数字设计和数字验证,这两个应该有所侧重,对于新人来说,哪个发展能够广一点    答:这两个本质是一样的,看个人兴趣。设计接触的面可能宽些。

2. 对于数字验证工程师,把UVM环境看通,能够搭建复杂的可重用的验证环境,除此之外还需要什么额外的技能需求吗?
    答:额外的技能就是看自己的发展道路,   
         工程师--->系统工程师(项目经理)--->IC研发总监--->公司研发总经理--->等等,干技术的需要的技能都在这条线上

3. 个人对IC比较感兴趣,但是目前有通信算法的IC设计和AI芯片的设计,算是两个小方向,前辈更看好哪一个呢?
    答:都好,没有什么可以比较的。

4. 关于FPGA原型验证,这个环节是不是一个可有可无的呢,FPGA里面的时钟树都已经固定了,时序约束在这里通过了也不能保证在ASIC中就没问题了;逻辑功能验证在UVM仿真中也能够发现;在FPGA原型验证阶段后仿还有必要吗?

    答:1、FPGA原型验证可以模拟一些芯片回来后的工作环境;比如可以做以下一些事情,举点例子给你
              A、比如做个单片机,fpga的原型板可以直接丢给软件人员做软件开发用呢。
                 B、比如你的芯片有很多接口(类似SPI I2C等等),那这些接口你不想看看,接口连到外部真正配套芯片,是否功能正确。
                      你内部测试spi的模型都是自己写的,谁知道对错
          2、FPGA原型验证和后仿没关系啊,前面侧重模拟芯片功能,后仿保证PR后的物理数据时序是OK的;
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发表于 2017-12-15 20:30:48 | 显示全部楼层
感动
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 楼主| 发表于 2017-12-15 20:45:40 | 显示全部楼层
补充一个,我做数字的,
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 楼主| 发表于 2017-12-16 10:35:33 | 显示全部楼层
回复 2# jackzhang
久仰久仰,,,
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发表于 2017-12-16 10:57:04 | 显示全部楼层
回复 1# rvisk


   很感动!像楼主这么有情怀的IC工程师,楼主您好,想问下CDC的问题,工程中有遇到两个不同时钟域的数据通信,一个10MHz,一个200MHz,数据从200MHz进入10MHz后仿真出现亚稳态,设计中也有做寄存器打拍,请问处理跨时钟有什么的好的方案?
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 楼主| 发表于 2017-12-16 12:13:18 | 显示全部楼层
回复 5# woai2020
这些东西有标准设计的,C公司S公司都有标准的建议。

跨时钟域的数据传输, 数据不要做寄存器打拍,用控制信号保证数据的传输正确性,俗称握手。大概意思如下图:

file:///C:/Users/ADMINI~1/AppData/Local/Temp/msohtmlclip1/01/clip_image002.jpg
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发表于 2017-12-16 15:29:34 | 显示全部楼层
回复 6# rvisk


   谢谢楼主
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发表于 2017-12-16 17:43:50 | 显示全部楼层
啥时候转行合适?
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 楼主| 发表于 2017-12-18 09:39:39 | 显示全部楼层
回复 8# hjacky2010


   哥们,啥时候都合适,只要你看得清楚你自己的发展道路
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发表于 2017-12-18 10:45:29 | 显示全部楼层
楼主您好,我是最近开始做驱动芯片上全定制SRAM的,想问下有没有什么资料推荐一下,或者有什么建议。因为现在处于比较迷茫的阶段。
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