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[原创] 个人写的DDR3的工作原理,欢迎大家拍砖!

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发表于 2015-5-23 22:45:07 | 显示全部楼层 |阅读模式

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硬件十万个为什么——DDR3的工作原理.pdf

721.59 KB, 下载次数: 4284 , 下载积分: 资产 -2 信元, 下载支出 2 信元

发表于 2015-5-24 00:28:47 | 显示全部楼层
很好 学习了  谢谢
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发表于 2015-5-24 20:12:01 | 显示全部楼层
非常感谢 !!!
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发表于 2015-5-24 23:20:17 | 显示全部楼层
能讲一下ODT的工作原理吗
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发表于 2015-5-25 17:32:48 | 显示全部楼层
下来看看,爱你这种无私的奉献哦
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 楼主| 发表于 2015-5-26 10:20:42 | 显示全部楼层


   
能讲一下ODT的工作原理吗
418478935 发表于 2015-5-24 23:20




   ODT的全称是on die terminal,用于调节阻抗,使输入信号具备好的信号完整性;   其电阻位于片内,称作RTT;实现ODT的RTT阻值通过MR寄存器MR1[9, 6, 2]设置。
   受到ODT调节的pin脚有DQ, DM, DQS, DQS#, and TDQS, TDQS#;



2222.jpg
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发表于 2015-5-26 10:37:38 | 显示全部楼层
DDR 1/2/3/4/5 工业品更新频繁,对于FPGA开发者没有必要关心DDR本身的工作原理(如果你是设计DDR芯片的除外),把更多的时间放在关注厂商提供的控制器接口上或许更实际。摆正位置,做好接口应用,不是做DDR芯片的就不要浪费时间了。及时花大力气做出来也可能不稳定BUG一堆,费力费神费资源。
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 楼主| 发表于 2015-5-26 10:50:47 | 显示全部楼层
回复 7# murphy522


   窃以为你的观点不对,如果把自己只定义为FPGA开发者;那么很多新的东西我们会错过。   固然这个版块是FPGA专版,但谁能说DDR的知识没有用?
   我见过有不了解DDR的同学做的驱动读写性能上不来。这个和访问方式还是有很大关系的。

上面说这么多,其实只是想说,知识没有必然的解耦性。不要因岗位的局限而限制自己的眼界!
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发表于 2015-5-26 11:04:15 | 显示全部楼层
兄弟,不要浪费过多的时间去追求什么原理,工作就不能再用学生那种思维模式。 曾经用过Altera的 DDR2/3 IP 现在用 XILINX mig 的 DDR2/DDR3 QDR 很快就搞定。把更多时间花在看厂商给的文档上。 估计老板不会等到你把DDR原理搞清楚了才开始项目吧。 老板要的是尽快的出结果,不是花钱让你在哪儿慢腾腾的搞什么原理。 DDR3很快就过时了,现在都上 DDR4了, 你还要去搞清楚DDR4的原理吗? 老板会愿意吗?
以后的DDR5 DDR6  呢,  你是在干厂商的活啊。但你拿不到ALTERA原厂或者XILINX原厂开发DDR控制器的开发人员的工资。何必呢!?
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发表于 2015-5-26 11:07:08 | 显示全部楼层
奉劝那些还在沉迷于弄DDR原理的.该醒悟了, 拿你搞原理的时间,多做一些接口,我几个功能、几个项目都搞完了,或许你的一个原理都还没搞清楚。
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