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哈哈1234 · 发表于 2017-9-2 16:14:02

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verilog中if(tx_sf_reg[0])表示什么意思？是tx_sf_reg[0]发生变化还是tx_sf_reg[0]==1'b1呢？

谢谢谢谢

zmw1986 · 发表于 2017-9-3 07:40:10

后者！！！！！

timtim016801 · 发表于 2017-9-3 08:19:57

if (tx_sf_reg[0]==1) 等同於 if (tx_sf_reg[0])
@(tx_sf_reg[0]==1)]是发生变化

哈哈1234 · 发表于 2017-9-5 10:33:31

回复 3# timtim016801
没看懂您写的，哪个是发生变化？

timtim016801 · 发表于 2017-9-5 12:12:34

有@的就是偵測发生变化

菜鸟要飞 · 发表于 2017-9-5 13:41:52

后者！！！！！

教父 · 发表于 2017-9-28 19:16:52

就是该信号为1 高电平

江山无限辉 · 发表于 2017-9-30 19:38:24

后者！

h9f3 · 发表于 2017-9-30 22:07:40

Thanks

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