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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 设计讨论 › cadence标准库中理想switch元件仿真问题
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楼主: brilliantt

[求助] cadence标准库中理想switch元件仿真问题

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reinmaker
发表于 2017-7-25 09:59:14 | 显示全部楼层
6666666666
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陈遐迩
发表于 2017-7-27 09:18:53 | 显示全部楼层
回复 10# brilliantt


  我曾经碰到过跟你一样的问题，后来解决的方法是在输出端串接一个1PF的电容，switch参数设置为Open resistance 1T ohm，Close Resistance:1 ohm。我的理解如下：相比ahdlLib库中的SW元件，AnalogLib库中的switch元件更符合实际情况，因为实际用开关的时候是要考虑自身导通电阻与负载电容的，所以开关输出端需要接一电容负载。不知道我的理解对不对？
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brilliantt
 楼主| 发表于 2017-7-27 20:33:17 | 显示全部楼层
回复 12# 陈遐迩

嗯嗯，赞同你的观点。
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leave22
发表于 2017-7-31 11:29:15 | 显示全部楼层
修改下close voltage和open voltage？这么正好是gnd和vdd的话不知道会不会有问题。
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kai19940914
发表于 2018-7-24 16:14:23 | 显示全部楼层
你把开关的控制端电压端接反了，所以一直都是导通的。
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Doooog
发表于 2018-9-21 10:49:02 | 显示全部楼层
回复 15# kai19940914


   人家没接反，你自己试试就知道了
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LLGUO
发表于 2018-11-5 15:06:54 | 显示全部楼层
谢谢你的分享 我去试试
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LLGUO
发表于 2018-11-5 15:08:59 | 显示全部楼层
有知道analogLib里面理想开关的resistance 1K欧姆 是什么意思，，可以修改这个默认参数不
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saber567
发表于 2018-11-23 04:25:16 | 显示全部楼层
usually, we set closed voltage as VCLK > VOS, and open voltage VCLK < VOS.
ps. open voltage cannot be the same as closed voltage
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ccyjobs
发表于 2019-5-21 14:46:39 | 显示全部楼层
switch要有直流通路才能工作，在switch的负端加一个接地的电阻就可以了
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