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查看: 2789|回复: 5

[求助] cyclone V altlvds 问题请教

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发表于 2017-6-5 15:04:38 | 显示全部楼层 |阅读模式

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各位:小弟最近用cyclone v 使用到了lvds接收装置。想请教一下cyclone v 跟cyclone iv的altlvds_rx的使用居然不一致了,想问问使用外部晶振时,rx_enable应该怎么接呢?谢谢了。
还有手册上让连到外部pll的时钟输出端,虽然能编译通过(还没有上板子测试)但完全不知道意义是什么。希望有大神能指点指点,顺便说一下这个IP核使用注意事项呗。

altlvds_rx

altlvds_rx
发表于 2017-6-5 19:27:49 | 显示全部楼层
这里external PLL 是只PLL不和LVDS IP一起例化。这里external PLL还是要使用FPGA内部的不是片外的PLL
 楼主| 发表于 2017-6-6 10:22:54 | 显示全部楼层
回复 2# zhangbinsniper


    对,这点我也理解到了,想问问这个rx_enable应该怎么连接呢?同样连接到pll一个输出上吗?
发表于 2017-6-6 19:39:50 | 显示全部楼层
rx_enable也是用PLL的LVDS模式来控制
 楼主| 发表于 2017-6-7 13:34:12 | 显示全部楼层
回复 4# zhangbinsniper


    就是直接修改pll为LVDS模式吗,连接到pll的output上吗?怎么输出
 楼主| 发表于 2017-7-3 10:40:33 | 显示全部楼层
回复 4# zhangbinsniper


    你好 这个问题能指点一下吗
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