LVS错误

小雷1994 · 发表于 2017-5-25 18:08:40

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我在做LVS时出现如下错误，请问是什么原因以及解决办法？谢谢！ (C~X6T__04HZONT6ZDS)A.png

Snowy2016 · 发表于 2017-5-25 19:04:25

你的power/ground没有打text，或是你虽然打了，但是没有写到runset里面。建议check一下，或者可以试试把ABORT ON SUPPLY关掉。

小雷1994 · 发表于 2017-5-25 19:41:09

回复 2# Snowy2016

我刚刚将标签层改了一下Matal-text，结果出现这个错误？这是怎么回事？ EN4Q(VLPLN`DC$J`39ECLS4.png

maomao198477 · 发表于 2017-5-25 20:43:54

信息量太小没法判断啊

叶落 · 发表于 2017-5-25 21:09:19

也有可能是power/ground短路了
同二楼所说：step_lvs options_ABORT ON SUPPLY勾掉

小雷1994 · 发表于 2017-5-25 21:30:42

本帖最后由小雷1994 于 2017-5-25 21:32 编辑

回复 5# 叶落

问题好像解决了，加了一层STCMOSID-dg,这个层是我调用mos管的时候就有的，当时觉得没什么用，就删掉了

，可能是这个导致无法识别mos管了，现在我的LVS好像通过了，想请教一下，那个ERC错误还要不要管？ 6DGFT93HA`NRC(FPW65DPXH.png

叶落 · 发表于 2017-5-25 21:43:12

ERC问题应该也要处理，可能是电位接的不对

maomao198477 · 发表于 2017-5-25 22:44:00

ERC 还是要稍微看一下有些可以忽略

Snowy2016 · 发表于 2017-5-26 08:54:18

回复 3# 小雷1994

“Nothing in layout”可能原因：1、power/ground识别不到，text layer不对？runset 没有设定power/ground name？
2、layout 层次有缺失，trace不出device
3、runset用错
……

小雷1994 · 发表于 2017-5-26 09:19:07

回复 8# maomao198477

我这个ERC可不可以忽略，因为ERC results File 那一项已经通过了，双击错误，它就是在版图的最外围加了一个矩形框，这个错误我看不懂是怎么回事，感觉电位没标错。。。

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