你们跑一个pll（Verilog-A模型），大概耗时多久啊

胭脂盗 · 发表于 2016-7-27 16:20:51

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每次跑一下模型都要一二十分钟，锁定时间要50us，内心是崩溃的

lwjee · 发表于 2016-7-27 17:03:17

好复杂的一个模型，一般5us就吧。带宽低就慢

一条鱼儿123 · 发表于 2016-7-27 17:05:38

你这已经很快了，我都是几个小时

胭脂盗 · 发表于 2016-7-27 19:52:54

回复 2# lwjee

我的模型感觉挺简单的，不知道为什么锁定时间那么长，带宽100k，为什么那么夸张啊

胭脂盗 · 发表于 2016-7-27 19:55:24

回复 3# 一条鱼儿123

可是我的模型一点也不复杂啊，看到别人都是几个us，大概问题会出在哪里呢望前辈指点

1261015620 · 发表于 2016-7-28 11:01:01

100k的带宽怎么着都要几十us吧...很正常...

一条鱼儿123 · 发表于 2016-7-28 11:17:20

回复 5# 胭脂盗

你可以将vco和div的模型合并在一起，这样会快一点

windwithgone · 发表于 2016-8-3 11:27:22

回复 7# 一条鱼儿123
VCO_DivideByN

胭脂盗 · 发表于 2016-8-4 11:57:23

回复 8# windwithgone

这样的话，到时候电路和模型混合跑还是要把vco和divider分开的啊

windwithgone · 发表于 2016-8-5 09:26:00

回复 9# 胭脂盗
正如你所说“vco和div的模型合并在一起，这样会快一点”，
还可以将PFD和CP合并，只是为了加快前期的behavior simulation的speed.

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