place_opt和clock_opt优化

kevin_zlm · 发表于 2015-9-14 18:53:39

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在apr进行place_opt和clock_opt优化中插入的CEL，不仅是BUF CEL 还有逻辑CEL?是什么原因导致的？

wjchuan · 发表于 2015-9-15 09:13:32

只是size up/down了吧，不会插入其他东西的，只是名字变了，不然逻辑变了

kevin_zlm · 发表于 2015-9-15 10:45:42

回复 2# wjchuan
确实插入了。并且最后大部分这种CEL并没有连接，就单独放着。是因为在.lib文件中有些CEL 设置了dont_use和dont_touch 为true。这个设置会导致这个问题的出现吗？

icfbicfb · 发表于 2015-9-15 17:57:11

logic optimization包括很多种优化，size up/down , logic remapping
具体细节不用管太多，

你说的cel没有连接是什么意思？是place加入的么
dont_use的cell 一般是不会被使用的，

kevin_zlm · 发表于 2015-9-15 19:09:41

回复 4# icfbicfb

place 优化中加入cell。就单独的一个cell放在那里，从各个图层看都没有连接。

icfbicfb · 发表于 2015-9-16 06:10:36

report_cell -connection 也没有么， place完又不是route完，怎么会有route连接呢

kevin_zlm · 发表于 2015-9-16 09:13:37

回复 6# icfbicfb

是route后的发现，因为它们的名称后缀是 ***/icc_place_opt_*。现在发现的问题大概是原厂提供的标准单元库出现问题。现在我重新生成库，重跑apr试试。
非常感谢版主！

yangzai1236 · 发表于 2015-9-16 21:33:12

好奇怪的问题

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