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[原创] 关于Components with non-identical signal pins

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发表于 2015-6-3 18:10:34 | 显示全部楼层 |阅读模式

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今天在做LVS时除了Components with non-identical signal pins的错误
Cell Comparison部分是正确的。
这里贴出我出现这个问题的原因,不排除有其他原因存在:

.subckt mim_cap POS NEG B
.ends

修改为

.subckt mim_cap PLUS MINUS B
.ends

暂时不知道为什么会这样,求大神解释下。
发表于 2015-6-4 09:06:49 | 显示全部楼层
有点儿印象是POS NEG是针对内建器件的,变成X开头的自定义器件要用plus minus,但是不知道你这个是不是这个问题。
 楼主| 发表于 2015-6-4 09:41:47 | 显示全部楼层
回复 2# tuohong


    我查了下svrf,貌似自定义器件也可以用POS NEG。

    是不是这里要跟pcell里面的定义match起来。Pcell里面的cdf有termName定义,还有那些view也有term name。
发表于 2015-6-4 10:22:08 | 显示全部楼层
我看了一下我手头的一套库,电阻和电容在CDF里面都用的是PLUS和MINUS,在command file里面电阻用的是POS和NEG,电容用的是PLUS和MINUS。这套库验证是好的,导出来的网表也没有额外include任何东西,所以可能没啥关系。
发表于 2015-6-9 09:34:25 | 显示全部楼层
先看看吧。感谢
发表于 2019-4-4 19:36:52 | 显示全部楼层
正巧也碰到这问题了
发表于 2019-4-25 08:31:12 | 显示全部楼层
把lvs result往下拉,应该会看到错误信息,就是网表和版图器件名称的对比。主要出现在手动添加的subckt里,遇到过的一个情况是网表写的WBPAD,版图抽取出来是wbpad,把网表修改了就好了
发表于 2021-7-21 09:48:43 | 显示全部楼层
工艺本身问题,跑lvs需要临时修改下网表,使版图和原理图端口pin的名称对应。
发表于 2021-8-17 14:54:15 | 显示全部楼层


笑书神侠1991 发表于 2021-7-21 09:48
工艺本身问题,跑lvs需要临时修改下网表,使版图和原理图端口pin的名称对应。 ...


大佬,请问可以详细说一下如何改网表吗,谢谢你
发表于 2022-1-13 10:57:31 | 显示全部楼层


HBPHBP 发表于 2021-8-17 14:54
大佬,请问可以详细说一下如何改网表吗,谢谢你


calibre-lvs界面,inputs-Netlist,在spice-files打开。export前面的√需要去掉,不然改了没效果。

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