既然有designware，为何要自己设计乘法器

hazzm02 · 发表于 2014-4-22 22:44:22

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本帖最后由 hazzm02 于 2014-4-25 11:02 编辑

我在DC里面试过了，乘法是可综合的。既然designware中都有很多种乘法器了，在RTL设计时为何还要自己设计呢？
可能有人会说，使用乘号，只能综合出组合逻辑，如果我们想要的是个5级流水线乘法器，就不行了。
但其实designware中是有时序逻辑的，比如说5级流水线乘法器。如果调用了DC现成的，这不是省时省力嘛。自己写的也不见得比designware中的来得好。

acgoal · 发表于 2014-4-23 08:07:10

试想一下，如果从来都没人设计乘法器的话，designware里面的是从哪里来的呢。

hazzm02 · 发表于 2014-4-25 11:01:45

回复 2# acgoal
谢谢版主的回答，可能我没说明白。我的意思是自己在写RTL代码时，可以调用designware中的乘法器，省得自己写。版主说得对，当然要有人去设计乘法器了。

acgoal · 发表于 2014-4-26 09:34:37

是的，如果不是专门的乘法器设计者，用户一般的来说，直接使用designware就够了。

mangotango · 发表于 2014-4-29 13:07:18

great post

richardxingxing · 发表于 2014-4-29 13:49:06

那你的代码就只好绑定Synopsys这一家了

peterlin2010 · 发表于 2014-4-29 13:59:12

除 synopsys 還有其他公司 logic synthesis 有類似 IP ?

无乐不作 · 发表于 2014-12-26 15:09:26

可以教我一下，如何正确使用想要的designware库中的IP吗

liuguangxi · 发表于 2014-12-27 21:03:43

回复 8# 无乐不作

直接例化IP核就行了，具体看DesignWare的user guide

nico0811 · 发表于 2015-4-8 18:14:41

有ACS的不？

[求助] 既然有designware，为何要自己设计乘法器

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