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[原创] UVM Examples

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发表于 2013-10-10 14:50:26 | 显示全部楼层 |阅读模式

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uvm_book_examples.zip (4.51 MB, 下载次数: 2410 )
UVM_ML-1.2.2.zip (9.96 MB, 下载次数: 3741 )
uvm_ref_flow_2013.05.zip (4 MB, 下载次数: 2017 )
发表于 2013-11-14 19:56:23 | 显示全部楼层
The UVM Reference Flow applies the Universal Verification Methodology (UVM) on
a realistic set of examples, which begin by showing aspects of the verification of
a block, a Universal Asynchronous Receiver Transmitter (UART).

It then shows how to verify a cluster design (a APB subsystem) into which the UART
gets integrated along with other design components (viz. SPI, GPIO, Power Controller,
Timers etc)

不错
发表于 2013-11-16 12:10:15 | 显示全部楼层
很好的UVM Examples。
发表于 2013-11-19 00:59:32 | 显示全部楼层
good data
发表于 2013-11-19 01:15:19 | 显示全部楼层
useful examples
发表于 2013-11-20 16:16:53 | 显示全部楼层
先看看。。。
发表于 2013-11-21 00:15:36 | 显示全部楼层
不错,,顶顶
发表于 2013-11-21 00:32:48 | 显示全部楼层
tai 棒了
发表于 2013-11-21 10:27:19 | 显示全部楼层
It's Everything I Hoped For!
发表于 2013-11-21 10:37:34 | 显示全部楼层
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