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前几天在用icc做cts的时候,需要设置优化约束:set_clock_tree_options -target_early_delay 0.5 -target_skew 0.1 在看过man后发现该命令中的delay即insertion delay感觉像时钟的network latency。但是在看过synopsis的timing constrains and optimization userguide后,发现有这么一段话: Source latency, also known as insertion delay, is the time it takes for a clock to be propagated from its ideal waveform origin point to the clock definition point in the design.(在67页)。瞬间感觉凌乱了。按照手册上的说法,这个insertion delay应该指的是时钟的source latency!有没有哪位大神能在这里跟我讨论讨论的?从以往的经验来看,我跟人觉得insertion delay更像是network latency。这只是个人愚见,如有错误请批评指正!谢了! |
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