ICC floorplan经验

Alicezw · 发表于 2013-8-22 12:03:06

回复 30# cool_lovexia

哦，谢谢您的解答！
可是为什么

把中间留出来，方便standard cell的摆放，以及以后的绕线资源会多一些

呢？
谢谢！

cool_lovexia · 发表于 2013-8-22 14:10:13

回复 31# Alicezw

个人理解：sram等宏模块会占用四层及其以下的层数，同时，对五六两层也会占用一定资源来做电源线，如果把它们放在中间的话，那就相当于中间这块区域，M1-M6都很难有地方给其他绕线

archillios · 发表于 2013-8-22 19:20:48

NP问题，hehe

Alicezw · 发表于 2013-8-23 14:40:05

回复 32# cool_lovexia

非常感谢您的解答！
您的意思是macro cell的地方会占用M1-M6的绕线资源，它们放在四周也是同样的啊。我可不可以这样理解？如果我把macro cell放在中间，那么standard cell只能放在四周，那走线就会绕很多，浪费资源，也使得时序很难收敛。
谢谢！

Alicezw · 发表于 2013-8-23 14:40:09

回复 32# cool_lovexia

非常感谢您的解答！
您的意思是macro cell的地方会占用M1-M6的绕线资源，它们放在四周也是同样的啊。我可不可以这样理解？如果我把macro cell放在中间，那么standard cell只能放在四周，那走线就会绕很多，浪费资源，也使得时序很难收敛。
谢谢！

cool_lovexia · 发表于 2013-8-23 16:50:10

回复 35# Alicezw

Macro cell 会占用M1-M4的全部绕线资源，占用M5-M6的部分绕线资源。至于为什么放边上，就像你说的，如果放中间，那么standard cell放边上，绕线就远了，因为中间有macro cell占了，走不通。

Alicezw · 发表于 2013-8-24 12:21:20

回复 36# cool_lovexia

嗯，谢谢！

无乐不作 · 发表于 2013-8-25 15:06:53

做FP的时候，经常会遇见这样的操作，
set_zero_interconnect_delay_mode true
report_constraint -all
set_zero_interconnect_delay_mode false
。。。
请问这样做的目的是什么？

loveheihei · 发表于 2013-9-13 10:48:29

回复 38# 无乐不作

去看在不算连线延时的时候的余量有多少，用来评估设计的可实现性的

xyz91978 · 发表于 2013-9-17 11:03:01

讨论的不错

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