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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端讨论区 › ICC floorplan经验
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楼主: seuxiaoj

[求助] ICC floorplan经验

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Alicezw
发表于 2013-8-23 14:40:09 | 显示全部楼层
回复 32# cool_lovexia

非常感谢您的解答！
您的意思是macro cell的地方会占用M1-M6的绕线资源，它们放在四周也是同样的啊。我可不可以这样理解？如果我把macro cell放在中间，那么standard cell只能放在四周，那走线就会绕很多，浪费资源，也使得时序很难收敛。
谢谢！
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cool_lovexia
发表于 2013-8-23 16:50:10 | 显示全部楼层
回复 35# Alicezw

Macro cell 会占用M1-M4的全部绕线资源，占用M5-M6的部分绕线资源。至于为什么放边上，就像你说的，如果放中间，那么standard cell放边上，绕线就远了，因为中间有macro cell占了，走不通。
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Alicezw
发表于 2013-8-24 12:21:20 | 显示全部楼层
回复 36# cool_lovexia


嗯，谢谢！
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无乐不作
发表于 2013-8-25 15:06:53 | 显示全部楼层
做FP的时候，经常会遇见这样的操作，
set_zero_interconnect_delay_mode true
report_constraint -all
set_zero_interconnect_delay_mode false
。。。
请问这样做的目的是什么？
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loveheihei
发表于 2013-9-13 10:48:29 | 显示全部楼层
回复 38# 无乐不作


   去看在不算连线延时的时候的余量有多少，用来评估设计的可实现性的
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回复 支持 2 反对 0

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xyz91978
发表于 2013-9-17 11:03:01 | 显示全部楼层
讨论的不错
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yeyu2004
发表于 2013-9-17 16:01:24 | 显示全部楼层
回复 21# jiancongwoo


    二哥就是牛啊
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wujiashangzhang
发表于 2013-9-19 10:28:19 | 显示全部楼层
tiger_lein说的非常有道理，不要盲目的去fp，那样效率很低，熟悉数据流是关键。
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zhanggd
发表于 2013-10-12 09:31:22 | 显示全部楼层
收藏了看看
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chengjiao
发表于 2013-10-12 10:05:14 | 显示全部楼层
一般情况两到三个floorplan就可以了
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