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[求助] set_wire_load_model 两种模式top和enclosed到底有什么区别?

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发表于 2011-12-12 23:35:47 | 显示全部楼层 |阅读模式

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书上说:top模式时,层次中的所有连线将继承和顶层模块同样的WLM
enclosed时,所有连线将继承完全包含该子模式的WLM
假如A模块是顶层模块,A包括B、C;B包括E、F;C包括G、H,
那么采用enclosed模式时,E、F模块继承B的WLM,B又继承A的WLM,那也就是整个设计的WLM都一样了,这和top,模式不就一样了嘛?

请问这两种模式到底有什么区别?谢谢
发表于 2011-12-13 09:04:41 | 显示全部楼层
如果只是设了一个top的WLM,那就没什么不一样了
如果对A或者B设了另一个WLM,那么B下面的net就会用B的WLM,而不是top的
发表于 2011-12-14 09:28:56 | 显示全部楼层
记得有本书讲过的,man下看看吧
缺省是top吧
发表于 2011-12-14 13:41:33 | 显示全部楼层
DC的user guide里面讲得很清楚
发表于 2012-12-15 17:10:24 | 显示全部楼层
线负载模型的数值set_wire_load_model为10X10,以及线负载模式set_wire_load_mode为top或者enclosed或者segmented,有什么区别?
也就是说线负载模型和线负载模式有什么区别?对设计有什么影响?大神解释下
发表于 2012-12-15 17:15:25 | 显示全部楼层
说的不错
发表于 2012-12-16 08:25:20 | 显示全部楼层
wire load model 和 wire load mode 是两个不同的概念
发表于 2012-12-16 10:45:53 | 显示全部楼层
回复 7# 陈涛


  那请问下版主:这两者有什么区别啊?
发表于 2013-1-3 15:18:35 | 显示全部楼层
如果EF没有设定mode,则它会往上层寻找,一旦找到B,则使用B的mode。如果B也没有设定mode,才会继续往上寻找,找到A,就以A的mode为准。
    Design Compiler uses the wire load model of the smallest design that fully encloses the
net. If the design enclosing the net has no wire load model, the tool traverses the design
hierarchy upward until it finds a wire load model. Enclosed mode is more accurate than
top mode when cells in the same design are placed in a contiguous region during layout.
Use enclosed mode if the design has similar logical and physical hierarchies.
发表于 2013-1-4 09:36:02 | 显示全部楼层
回复 8# xmffsf


    推荐你看看这个资料,Timing Constraints and Optimization:
    Timing Constraints and Optimization.pdf (3.85 MB, 下载次数: 1994 )
    第5部分的Mode Analysis和Wire Load Models可能对你会有帮助。
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