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[求助] 请教 Prime Time 的几个问题

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发表于 2012-10-25 10:06:04 | 显示全部楼层 |阅读模式

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本帖最后由 61ping 于 2012-10-29 16:21 编辑

先前只做过PT的WORK SHOP ,目前正在根据DDR3的SPEC写约束,请教一下:
1怎么设置input的capacitance,或者,这个设置是否必要?
  如果不必要,那电气规范里把这一项列出来是用作什么的?

2 Capacitance load tab里还列出了differential pair signal的delta CAP,这一项又应该怎么反映到约束里面去?

3 对于手册里面给出的时钟信息,里面提供min_pulse_width (HIGH 和 LOW都提到了),
   也提到了max_pulse_width,要根据这个信息作出对应的约束,应该使用
    set_min_pulse_width
   或是 set_pulse_clock_max_width和set_pulse_clock_min_width 命令呢?

4 根据一个标准或者规范来对设计写约束,有没有更加有效的办法?


先谢谢解答问题的各位了!
 楼主| 发表于 2012-10-25 11:24:44 | 显示全部楼层
补充一下,手册里面提供的jitter的信息,又应该怎么反应到约束里面去呢?
发表于 2012-10-25 12:31:18 | 显示全部楼层
input的capacitance可以定义为set_load;
jitter和latency定义为set_uncertainty;
 楼主| 发表于 2012-10-25 14:53:06 | 显示全部楼层
回复 3# Gary.wang

set_load可以用于INPUT PORT吗?

目前写的是 set_max/min_capacitance -port
这样是否可行?
如果不行,有什么不妥?


谢谢!
发表于 2012-10-25 16:47:47 | 显示全部楼层
刚才man了一下这个命令set_max/min_capacitance -port;一般情况下没有必要设置这个属性,如果设置的不合理会影响综合;如果lib里面有这个属性,工具会以lib里面为准;
 楼主| 发表于 2012-10-29 09:46:19 | 显示全部楼层
回复 5# Gary.wang


    还有个问题,能否请教您一下

    对于手册里面给出的时钟信息,里面提供min_pulse_width (HIGH 和 LOW都提到了)也提到了max_pulse_width,要根据这个信息作出对应的约束,应该使用
    set_min_pulse_width
或是 set_pulse_clock_max_width和set_pulse_clock_min_width 命令呢?

   初次做lab以外的内容,很多东西不懂,还请指教,谢谢!
发表于 2012-10-29 12:50:09 | 显示全部楼层
一般检查最小脉冲宽度
set_min_pulse_width -high 1.5 [all_clocks]
set_min_pulse_width -low 1.0 [all_clocks]
report_min_pulse_width
 楼主| 发表于 2012-10-29 13:28:04 | 显示全部楼层
回复 7# Gary.wang


    但是spec里面连max pulse width也指定了,这个不需要设置吗?

   另外,对于differential pair 的某个parameter,既给出了accurate value,又给出delta value,例如电容,对此应该如何设置?

谢谢
发表于 2012-10-29 15:26:43 | 显示全部楼层



因为时钟经过一堆buf后,会越来越窄,所以一般检查最小宽度,太窄的话,触发器检查不到;

期待专家解答吧,知识有限!哈哈
 楼主| 发表于 2012-10-29 16:21:49 | 显示全部楼层
回复 9# Gary.wang


   仍然谢谢您!
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