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查看: 4383|回复: 10

[求助] 怎样快速看懂一个较大的verilog模块代码

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发表于 2012-8-20 21:47:23 | 显示全部楼层 |阅读模式

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求助大牛:
    在没有相关specification的前提下,怎样快速看懂一个较大的verilog模块代码,求助啊

   谢谢!!!
发表于 2012-8-20 22:55:18 | 显示全部楼层
simulation
发表于 2012-8-20 23:22:10 | 显示全部楼层
1、先总体,再局部分析各个模块的大致功能(通过仿真推测)
2、不要太关注某条语句。关注总体
3、可以尝试画出模块内信号流图,模块间边接关系
发表于 2012-8-21 22:31:42 | 显示全部楼层
关注输入输出,大体功能,然后结合仿真
发表于 2012-8-22 08:44:21 | 显示全部楼层
回复 4# zhaichunhua168


    由整体到局部可以很快的理解电路
发表于 2012-8-22 11:06:46 | 显示全部楼层
用verdi查看模块的框图和接口,然后看看每个接口是用来做什么的,每个模块是用来做啥的,然后再仿真看看输出什么
发表于 2012-8-22 23:02:47 | 显示全部楼层
我通常都是关注他的功能和接口。
仿真的话需要知道输入的时序才行吧……
发表于 2012-8-22 23:54:59 | 显示全部楼层
1.仿真 2.从整体的角度看 3.将程序模块化 4从部分解读
发表于 2012-8-23 06:59:55 | 显示全部楼层
关注输入输出口重点信号也是个办法,比如数据,地址,控制信号之类的,你能把这模块里的高位宽数的信号,比如32BIT宽,其数据流向在各个模块之间如何走动捋一遍,就清楚多了。
 楼主| 发表于 2012-8-23 08:39:40 | 显示全部楼层
回复 3# tsingyingz


    如何通过仿真推测!!!输入信号较多,在不理解大致功能的情况下激励信号不知道怎么加 啊
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