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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › Altera FPGA CPLD设计基础篇

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楼主: hjchen01

[资料] Altera FPGA CPLD设计基础篇

发表于 2012-2-15 21:06:29 | 显示全部楼层

顶啊aaaa

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发表于 2012-2-15 21:09:15 | 显示全部楼层

还差几个啊，哎

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发表于 2012-2-15 21:13:00 | 显示全部楼层

好艰难啊

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发表于 2012-2-15 21:15:12 | 显示全部楼层

积分啊

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发表于 2012-2-15 21:18:25 | 显示全部楼层

回复 224# yuzhc123

haonan a

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发表于 2012-2-15 21:23:09 | 显示全部楼层

ddddddd

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发表于 2012-2-15 21:23:56 | 显示全部楼层

回复 221# yuzhc123

haiyou haoduo a

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发表于 2012-2-15 21:27:00 | 显示全部楼层

zhongyu yao xiawang le

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发表于 2012-3-7 23:16:18 | 显示全部楼层

找了很久……都是不清晰的，看这个清晰不~

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发表于 2012-3-7 23:20:22 | 显示全部楼层

额。。。居然要全下完才能解压。。。

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