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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端讨论区 › 关于ICC做完placement以后cell急剧增多的问题 ...
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查看: 3477|回复: 7

[求助] 关于ICC做完placement以后cell急剧增多的问题

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shehuang1987
发表于 2011-6-22 21:20:50 | 显示全部楼层 |阅读模式

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本人在用ICC生成版图的时候遇到如下问题：在跑完DC后的cell个数为37867，但是一做完placement，cell个数增大为191077，几乎是原来的5倍，导致在initial floorplan的时候要把core untilization设到0.1左右placement才能通过。
难道是因为我里面有几个fanout大于1000的pin，使得需要create很大的buffer_tree，才使面积增大那么多？但是想想这也不太可能使单元个数增加那么多啊。
想请问哪位高手遇到过这种问题，希望不吝赐教啊。
create, initial, 左右

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陈涛
发表于 2011-6-22 23:20:15 | 显示全部楼层
除非是BUG，不然没人能回答，因为可能的情况太多，floorplan不合理，constraint太紧，，，

你可以找1，2个ICC增加的cell，向前向后显示整条路径，看看到底为什么ICC要那么做
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arnold1019
发表于 2011-6-23 11:33:25 | 显示全部楼层
以前有碰到,大都是constrain不合理造成.
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shehuang1987
 楼主| 发表于 2011-6-23 14:46:15 | 显示全部楼层
回复 3# arnold1019
请问：是不是指做综合的时候加的约束不合理啊？得重新综合？
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shehuang1987
 楼主| 发表于 2011-6-23 14:49:24 | 显示全部楼层
回复 2# 陈涛
谢谢陈版主，我再看看到底是什么问题引起的。
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apacheda
发表于 2011-6-23 16:17:24 | 显示全部楼层
建议前端重新综合， Review一下他们的 SDC，看下他们为什么要那么做。
或者让前端加紧约束，综合一下。
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chris_li
发表于 2011-6-23 18:02:30 | 显示全部楼层
建议查查导出的sdc吧。
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lint123
发表于 2011-6-29 21:25:29 | 显示全部楼层


以前有碰到,大都是constrain不合理造成.
arnold1019 发表于 2011-6-23 11:33

                               
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