spectreverilog仿真问题

小萝卜头 · 发表于 2009-4-1 14:36:14

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请问在用spectreverilog进行数模混仿时，如何将数字.v设计代码转化为symbol的形式？谢谢

gaom9 · 发表于 2009-4-2 09:33:20

用library manager 打开 .v文件，然后保存退出 esc、 : 、 wq，这样cadence就会帮你检查.v文件是否有错误，要是没有错误就会弹出类似 the symbol of ** do not exit, do you want to create it now之类的对话框，选择yes就可以创建了，下来你到symbol cell里面去修改那个symbol就可以了

lyk511 · 发表于 2009-6-19 14:27:58

,,,,,,,,,,,,,,

defg428 · 发表于 2009-6-22 18:47:27

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diao_jing · 发表于 2009-7-1 17:13:16

原帖由 小萝卜头 于 2009-4-1 14:36 发表

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请问在用spectreverilog进行数模混仿时，如何将数字.v设计代码转化为symbol的形式？谢谢

菜鸟走过，求人回答！

qmq008 · 发表于 2010-6-29 22:27:33

新手，帮顶，

bmezcc · 发表于 2010-7-1 19:04:24

谢谢，领教了。

xbbx8517 · 发表于 2010-7-7 17:13:08

2# gaom9
请问一下,如何用Library manager打开.v文件啊?我将.v文件导入到Cadence中,但是用library manager看不到这个文件啊.请大侠指点一下.谢谢!

Hellboy · 发表于 2010-7-9 13:47:20

没必要那么麻烦吧，你直接在外边把verilog文件仿好，用cadence直接将.v文件import进去当成一个functional就行了，cadence会自动生成一个symbol，或者你自己用新建cellview的方法建一个symbol也可以，找本混仿的书看看就行，原理不难

mcjoyway · 发表于 2010-8-19 20:44:23

没必要那么麻烦吧，你直接在外边把verilog文件仿好，用cadence直接将.v文件import进去当成一个functional就行了，cadence会自动生成一个symbol，或者你自己用新建cellview的方法建一个symbol也可以，找本混仿的书看看 ...
Hellboy 发表于 2010-7-9 13:47

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YES, you are right!

defg428 defg428 当前离线积分 65 头像被屏蔽	发表于 2009-6-22 18:47:27 \| 显示全部楼层提示: 作者被禁止或删除内容自动屏蔽
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