关于PLL中PFD以及CP模块的PN仿真！！！

JerryKinggg · 发表于 7 小时前

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本帖最后由 JerryKinggg 于 2025-12-3 15:32 编辑

这是CP联合PFD仿真的PN图

这是PFD单独仿真的PN图

CP模块中的运放的频率/相位裕度

小弟最近弄毕业设计，现在做到PLL单独模块的前仿真，PFD以及CP模块的PN仿真性能特别差，网上随便找了论文都能做到-200dBA/Hz左右的PN，小弟也问过AI关于dBA/Hz以及dBC/Hz这两个单位的区别，十分好奇，究竟该将哪一个单位做为我仿真优化的方向。

以及好奇为什么引入了CP之后，整个PN的仿真图跟PFD单仿真区别那么大，鼠鼠已经快碎掉了，没有人一起聊天解决问题真是难办T T

JerryKinggg · 发表于 7 小时前

顶一下，希望大佬们给点建议

JerryKinggg · 发表于 4 小时前

顶一顶，走过路过看一看给小弟点建议

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