calibre2022.2版本跑lvs，报错说Exporting source failed

科成芯片协会 · 发表于 2025-10-29 18:27:51

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本帖最后由科成芯片协会于 2025-10-29 19:08 编辑

大佬们，求助用calibre2022.2版本跑lvs，说我提取电路网表错误，然后我尝试了check and save schem，重启，都是不行的，最后我自己提的电路网表cdl，然后就可以运行lvs，理论上不是应该lvs自动提取吗，warning说的是我这些文件已存在，应该没啥关系，主要是schem的问题

fengrlove · 发表于 2025-10-29 19:13:43

CIW 报的啥错呀，

ericokkyy · 发表于 2025-10-29 20:13:03

要從sachematic那裡開layout XL 再跑LVS

科成芯片协会 · 发表于 2025-10-30 08:20:16

ericokkyy 发表于 2025-10-29 20:13
要從sachematic那裡開layout XL 再跑LVS

我尝试了还是说Exporting source failed

科成芯片协会 · 发表于 2025-10-30 08:27:14

fengrlove 发表于 2025-10-29 19:13
CIW 报的啥错呀，

科成芯片协会 · 发表于 2025-10-30 08:42:41

fengrlove 发表于 2025-10-29 19:13
CIW 报的啥错呀，

大佬啊，是不是因为这个应该是aucdl ,aucdl schematic

TCKG · 发表于 2025-10-30 09:06:08

科成芯片协会发表于 2025-10-30 08:42
大佬啊，是不是因为这个应该是aucdl ,aucdl schematic

在启动virtuoso前，先在终端输入:export CDS_Netlisting_Mode=Analog，重启virtuoso 跑lvs试试

fengrlove · 发表于 2025-10-30 09:06:20

科成芯片协会发表于 2025-10-30 08:42
大佬啊，是不是因为这个应该是aucdl ,aucdl schematic

对呀

waves_0011 · 发表于 2025-10-30 10:03:40

把export from source viewer勾选上，然后你会看到左侧有红色感叹号，这时候到run control界面的design tool setting点一下connect再运行就没问题了

涡轮的轰鸣 · 发表于 2025-11-5 20:30:18

waves_0011 发表于 2025-10-30 10:03
把export from source viewer勾选上，然后你会看到左侧有红色感叹号，这时候到run control界面的design too ...

,跟这个不是同一个错误，我之前遇到你说的这个，现在遇到楼主这个

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