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[求助] 抗辐射加固设计

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发表于 2025-8-19 12:12:55 | 显示全部楼层 |阅读模式

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万能的网友啊,图示是一个ADC里面的存储器模块,M3和M4是比较器比较结果的输入对管,现在我想对他进行相应的辐射加固设计,主要是抗单粒子翻转设计,我分析了半天主要是对其前面6个管子进行加固设计,但是我看了很多文献也思考了很久始终不知道该怎么加固,恳请各位大佬帮忙看看,给点想法,小弟跪谢了
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 楼主| 发表于 2025-8-19 12:15:17 | 显示全部楼层
他电路的原理在这篇文献里面

低压低功耗12位逐次逼近型A_D转换器设计与研究_艾方强.pdf

10.38 MB, 下载次数: 39 , 下载积分: 资产 -4 信元, 下载支出 4 信元

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发表于 2025-8-19 17:24:34 | 显示全部楼层
做成3选2?
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发表于 2025-8-19 18:38:26 | 显示全部楼层
什么是加固设计?
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发表于 2025-8-19 19:13:18 | 显示全部楼层
N管浮地?SUB不共?
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发表于 2025-8-19 22:09:40 | 显示全部楼层
看你的版图面积了,一般加一下N/P MOS的间距,给PMOS的Nwell 外面在加一个很宽的接地的Pwell,加大电阻同时让电流有地方泄放,SEL不容易建立就行。或者直接上SOI的工艺,SEE就很简单了。
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