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该电路源文件设计信息：
第一级6位SAR ADC、余量放大器、第二级8位SAR ADC、数字校正电路 总分辨率为12bit，采用6+8的两级架构，级间冗余2位，第一级SARADC为6bit，要达到12bit的分辨率，则单位电容的失配率小于0.092%；第二级 SAR ADC 为 7bit，要达到 7bit的分辨率，则单位电容的失配率小于 4.1%
余量放大器以闭环的形式实现8倍的放大
对于第一级ADC，采样时间为0.95ns，量化时间为4ns，余量放大器放大时间4.6ns。1/10采样，4/10第一级量化，5/10余量放大
以下隐藏内容为本电路源文件设计基于的工艺信息：
n电源电压1.2V，采样时钟100MHz，信号带宽50MHz
系统总体指标：输入fclk=100MHz， fin=47×fclk/1024Hz，Vcm=600mV，amp=400mV，为ADC满摆幅输入 n有效位数ENOB：11.6bit
n信噪比SNR：61.20dB
n无杂散动态范围SFDR：71.26dB
n总谐波失真THD：-70.97dB
| 第一位ADC | 第二位ADC | | 输入范围 | 200mV~1V | 400mV~800mV | | Vref | 800mV | 400mV | | 采样开关 | 栅压自举开关 | | 采样技术 | 下极板采样 | | 采样时钟 | 时钟SAM-、CKS | 两相非交叠时钟CK1/CK2、CKS | | CDAC阵列位数 | 6+1 | 7+1 | | 采样电容 | mim电容19.5fF，5pF | mom电容2.5fF，1.28pF | | 比较器 | NMOS输入对管两级动态比较器 | PMOS输入对管两级动态比较器 | | 1LSB | 12.5mV | 1.56mV | | 输出范围 | Vcm±12.5mV | Vcm±1.56mV |
免责声明：
该电路非本人设计，并没有拿该电路进行盈利。分享该电路主要帮助初学者少走弯路，加快学习速度。发扬互联网开源精神，不要重复造轮子。
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