分频器sampled jitter相噪设置

xq19901211 · 发表于 2024-8-13 21:11:45

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本帖最后由 xq19901211 于 2024-8-14 18:49 编辑

请教大神们，分频器相噪仿真，用sampled jitter和time average比较，感觉time average相噪比sampled jitter大很多，但是又不知道sampled jitter设置的对不对

我有以下问题：
1.trigger应该选那个 positive output node?
2.Edge number和edge direction怎么设置？
如果关注上升沿，dege direction选rise，怎么知道edge number是选对了？
3.sleep time怎么设置？

从time average 仿真结果看，100k之前PM噪声大，100K之后AM噪声大，造成PM和AM噪声偏大的原因是什么？

xq19901211 · 发表于 2024-8-15 09:20:53

还有一个问题，分频器AM和PM都要关注吗？怎么减小AM和PM噪声？

Augustus98 · 发表于 2024-10-23 11:13:58

怎么说有结论吗

xq19901211 · 发表于 2024-10-23 14:56:47

Augustus98 发表于 2024-10-23 11:13
怎么说有结论吗

没有明确的，多试试吧，分频器是有沿的说法

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