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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 设计讨论 › 关于后仿的问题
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查看: 1114|回复: 5

[求助] 关于后仿的问题

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Yeahtools
发表于 2024-7-3 16:46:59 | 显示全部楼层 |阅读模式
100资产
本帖最后由 Yeahtools 于 2024-7-3 16:48 编辑

最近在改个SAR ADC，跑后仿的时候遇到了问题。
在比较器里面有个BIAS电路，如下图，在ADC整体后仿的时候，bias电压不够，但是单独后仿比较器时，BIAS正常。从两次分别提取的寄生参数来看，也没有什么大差别，不知道问题到底出在哪里。按道理寄生电容应该也不会影响到BIAS电路呀。难道比较器会反过来影响bias?
dbce2c26b8db8bccf3d7fd12ae904df.png

最佳答案

aishan007

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提个noRC，看看是不是CC引起的
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aishan007
发表于 2024-7-3 16:47:00 | 显示全部楼层
提个noRC，看看是不是CC引起的
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Yeahtools
 楼主| 发表于 2024-7-4 15:06:51 | 显示全部楼层
本帖最后由 Yeahtools 于 2024-7-4 15:15 编辑


aishan007 发表于 2024-7-4 10:11
提个noRC，看看是不是CC引起的


好的，我试试
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Yeahtools
 楼主| 发表于 2024-7-4 15:56:47 | 显示全部楼层


aishan007 发表于 2024-7-4 10:11
提个noRC，看看是不是CC引起的


真的是CC的问题，那是不是得从版图布线找问题。（第一次跑后仿，没经验）
EETOP创芯人才网职位发布入口
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aishan007
发表于 2024-7-4 16:38:55 | 显示全部楼层


Yeahtools 发表于 2024-7-4 15:56
真的是CC的问题，那是不是得从版图布线找问题。（第一次跑后仿，没经验）
...


先layout上查，看看是否有明显的耦合的走线；如果找不到，就把后仿网表里的cc电容每次注释掉一些，看注释哪根线的cc的时候现象消失。
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Yeahtools
 楼主| 发表于 2024-7-4 17:13:12 | 显示全部楼层


aishan007 发表于 2024-7-4 16:38
先layout上查，看看是否有明显的耦合的走线；如果找不到，就把后仿网表里的cc电容每次注释掉一些，看注释 ...


好的，谢谢，这就去找
EETOP创芯人才网职位发布入口
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