verilog ams中算术运算出错

xdf666 · 发表于 2024-3-28 16:36:17

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各位前辈好！小弟在verilog-ams模块中写了一个6bit算术运算表达式。但是仿真发现，得到的结果最高位总是与正确情况相反。

比如正确情况下最高位应该为1，但是仿真结果为零。

其他LSB没有出现错误。

请问这种一般是什么原因呢？Verilog-ams会默认把算术运算涉及的多比特数当作有符号数处理嘛？

xdf666 · 发表于 2024-3-28 16:37:24

自己顶一下，有没有前辈来指点一下呀？

xduic · 发表于 2024-3-28 17:32:29

建议自己举个数手算一下 6bit也不是很复杂

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