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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog Layout（版图） › Layout资料区 › T40围环的时候出现了下面问题
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查看: 1752|回复: 2

[原创] T40围环的时候出现了下面问题

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发表于 2023-5-8 10:09:02 | 显示全部楼层 |阅读模式

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T40围环的时候出现了下面问题,在围环前选择了SN或SP,画出的环就带出了多余的SN或SP,请问哪位高手是怎么回事?
QQ截图20230508095910.jpg
QQ截图20230508095942.jpg
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发表于 2023-8-3 10:09:00 | 显示全部楼层
围环之前选择AA层试一下。
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发表于 2024-12-13 14:50:06 | 显示全部楼层
感谢，我也是想要的
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